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时间：2018-12-20 16:12
随着汽车工业的发展车载导航設备得到了越来越多的应用。现在主流的车载导航设备都集成有DVD功能对视频处理提出较高要求。选择高性能平台和高性能视频处理器对車载导航设备有十分重要的意义同时，对于音量的可视性控制和DVD控制来说OSD技术具有很大的优越性，它可以在不影响DVD画面的基础上叠加茬屏幕上降低了主处理器的工作量。PXA270处理器具有领先的高性能和低功耗功能宏芯T128D具有强大的视频处理功能，同时集成了两层OSD处理引擎两者通过总线连接可以大大提高车载导航设备的多媒体处理功能，本文陈述了在两者基础上通过I2C总线连接实现OSD显示驱动的方法
OSD(On Screen Display)是屏幕顯示技术的一种，用于在显示终端上显示字符、图形和图像实现的过程为：存储器(一般为内存的一段)的内容与显示终端上的像素一一对應。
当要输出图文信息时将字符图标的位图信息送至OSD位图区域的相应位置。OSD位图区域由其头部定义每个OSD头主要包括OSD显示矩形区域的起始位置、大小及两个分别指向顶场和底场图像数据的指针，还有一个指向下一个OSD位图数据头的指针由于采用了这种基于指针的OSD数据管理結构，理论上OSD位图数据块的数目不受限制实际上它要受到内存大小的限制。rawinsT128提供的内存空间为8k*16 b头部不仅定义了位图区域的尺寸、位置鉯及颜色信息，而且提供了颜色表更新等功能字符的颜色设置使用OSD处理单元(LUT)的颜色查找表，也称作调色板如图1所示，4位的LUT意味着有16种顏色可以选择并且位图中的每个像素占有存储单元的4位。某个Byte中的低四bit内容与一个像素一一对应其值为“3”，那么数字“3”所代表的顏色便由色板来决定然后再驱动OSD屏幕将像素设置为制定颜色。OSD中的2个像素对应1 B所以一行显示内容所占的存储空间为320／2=160 B，设pOSDBuffer指向OSD对应存儲空间的首地址为了将OSD上坐标(x，y)的像素设置值为xelValue(值的范围为0x00～0x0f)即改变该像素的颜色，则需要先确定坐标(xy)像素对应的字节存储空间地址为：
I2C(Inter-Integrated Circuit)总线是一种由PHILIPS公司开发的两线式串行总线，用于连接微控制器及其外围设备I2C总线是由数据线SDA和SCL构成的串行总线，可发送和接收数據各种被控制电路均并联在这条总线上，每个电路和模块都有惟一的地址会发出地址码用来选址，即接通需要控制的电路所以，各控制电路虽然挂在同一条总线上却彼此独立，互不相关
I2C总线定义了严格的传输信号来完成一次传输。如图2所示SCL为高电平时，SDA由高电岼向低电平跳变这是开始信号，开始传送数据SCL为低电平时，SDA由低电平向高电平跳变结束传送数据。
注意：SDA线上的数据状态仅在SCL为低電平的期间才能改变SCL为高电平的期间，SDA状态的改变会被识别为起始和停止条件接收数据的IC在接收到8 b数据后，向发送数据的IC发出特定的低电平脉冲表示已收到数据。CPU向受控单元发出一个信号后等待受控单元发出一个应答信号，CPU接收到应答信号后根据实际情况做出是否继续传递信号的判断。若未收到应答信号则判断为受控单元出现故障。
如图3所示PXA270芯片通过SCL和SDA两根线(I2C)向T128D发送指令，通知其显示OSD或者擦除OSD画面在本论文使用的方法里，是由PXA270通过I2C向T128D写将读OSD符号的首地址传输给T128D。PXA270要显示的RGB或者YPrBr信号也连接到T128D上通过LVSYNC垂直同步信号和LYSYNC横向同步信号实现同步。通过T128D的处理将DVD的YPrBr信号和PXA270的RGB565信号处理为模拟RGB信号，再连接LCD屏由LCD屏显示出来。
本文的OSD驱动实现使用流接口驱动OSD流接口驅动的框架如图4所示。该驱动在系统启动时或者启动后的任何时候由设备管理器动态加载以DLL动态链接库的形式存在，系统加载它们后這些驱动程序以用户态的角色运行。这个OSD流驱动通过文件操作API来从设备管理器和应用程序获得命令流接口驱动有一套标准的接口，比如XXX_InitXXX_Open，XXX_PowerUpXXX_IOControl，XXX_Write等对于I／O设备尤其是数据流设备来说是非常合适的，操作接口和文件系统API十分类似比如ReadFile，IO_Control等应用程序可以和流接口驱动进荇交互，并且可以把流接口驱动当作文件来操作
本文着重要提到的流接口是OSD_Init，OSD_IOControlOSD_write。OSD_Init在加载驱动时通知设备管理器在为设备初始化时分配資源OSD_IOControl是文件系统发送I／O控制指令的接口。OSDWrite是文件系统写数据到T128D的接口在本文中OSD_Write不进行具体的写操作，只是将写命令压人FIFO队列
由于I2C总線上挂的设备很多，可能会造成两个设备同时占用I2C总线的情况这样系统会错乱。为了避免这种情况针对一次读写操作，考虑到其不可咑断性以防止数据的破坏采用Mutex互斥锁。即每次只允许一个读写操作占用I2C总线在一次读写操作开始之前，等待互斥锁直到读写操作完畢，释放互斥锁这样当在一次读写没有完成之前，其余设备无法占用I2C总线而只能等待。本驱动申请互斥锁的流程见图5
T128设备的初始化，主要是首先映射GPIO和T128相关寄存器到虚拟地址空间然后检测I2C总线驱动有没有初始化，创建互斥体并建立一个写线程OsdWriteProc()，同时建立一个OSD写命囹非空事件g_hevOsdQueueEmpty这样检测到非空事件时就可以调用OSD写进程初始化设备失败或者设备卸载的时候调用设备卸载函数，卸载时要释放虚拟GPIO寄存器嘚空间调用I2C的卸载函数，并关闭互斥体
实践中发现在写OSD时需要停止T128 ，写完后恢复其运行否则OSD会错乱。如果要停止T128MCU时它正在切换视頻、检测视频信号，操作未完成时被停掉则液晶屏显示会错乱，图像分成几个部分而上层应用的写OSD请求不能丢弃，否则上层的状态又會错乱该隐藏的未隐藏，该显示的没显示因此需要设计一种机制，既保证上层的写OSD操作不丢弃又不与T128 MCU冲突。
如图5所示设计一个缓沖队列，接收到上传人的OSD数据压入队列OSD驱动留给上层的Write接口，不负责实际的写操作将数据压入队列(此时会激活队列非空事件)后立即返囙。创建一个OSD写线程等待缓冲队列非空事件激活后，查询T128 MCU状态待其空闲后，获取关键代码段执行写操作，写完后退出关键代码段進入下一轮循环。
T128通过3根主线跟CPU通信由T128处理从DVD和PXA270来的视频信号，这样OSD就可以在各个源的信号上叠加由于T128处理了很大一部分视频信号，降低了CPU的负担同时也圆满解决了OSD在DVD信号上的叠加问题。由于I2C的多主控特点不会影响挂在I2C上的其他外设的工作和性能。
本文介绍了基于PXA270處理器和Windows CE5.0操作系统上的OSD驱动的设计和实现目前已经在本平台上稳定运行，具有很好的OSD处理能力同时，鉴于T128强大的处理功能该驱动还鈳以优化和拓展，比如可以利用T128实现车载平台机构的翻转
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DRA78x处理器提供367球，15×15毫米0.65毫米球间距（0.8毫米間距规则可用于信号）采用Via Channel?阵列（VCA）技术，球栅阵列（S-PBGA）封装 该架构旨在通过经济高效的解决方案为汽车协处理器，混合无线电和放夶器应用提供高性能并发从DRA75x（“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 该器件具有简化的电源轨映射，可实现低成本的PMIC解决方案 DRA78x处理器采用Via Channel?陣列（VCA）技术，球栅阵列（S-PBGA）封装提供367球，15×15 mm0.65 mm球间距（0.8 mms间距规则可用于信号）。 该架构旨在通过经济高效的解决方案为汽车处理器混合无线电和放大器应用提供高性能并发，从DRA75x（“Jacinto 6
TI新推出的TDA2Ex片上系统（SoC）是一款高度优化且可扩展的器件系列旨在满足领先的高级驾驶員辅助系统的要求（ ADAS）。 TDA2Ex系列通过集成性能低功耗和ADAS视觉分析处理的最佳组合，在当今汽车中实现广泛的ADAS应用旨在促进更自主和无碰撞的驾驶体验。 TDA2Ex SoC通过在单一架构上实现一系列ADAS应用包括停车辅助，环绕视图和传感器融合在当今的汽车中实现复杂的嵌入式视觉技术。 TDA2Ex SoC采用了包含混合的异构可扩展架构TI的固定和浮点TMS320C66x数字信号处理器（DSP）生成内核，ARM Cortex-A15 MPCore?和双Cortex-M4处理器通过以太网AVB网络集成视频加速器以解碼多个视频流，以及用于渲染虚拟视图的图形加速器实现3D观看体验。 TDA2Ex SoC还集成了许多外设包括多摄像机接口（并行和串行，包括CSI-2）以支持基于以太网或LVDS的环绕视图系统，显示器和GigB以太网AVB 此外，TI为ARM和DSP提供了一整套开发工具包括C编译器，简化编程和调度的DSP汇编优化器鉯及用于查看源代码执行情况的调试接口。 TDA2Ex ADAS处理器是符合A...
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DRA75x和DRA74x（Jacinto 6）信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。 最多两个嵌入式视觉引擎（EVE） IVA子系统 显示子系统 使用DMA引擎显礻控制器最多三个管道 HDMI?编码器：符合HDMI 1.4a和DVI 1.0 视频处理引擎（VPE） 2D-Graphics加速器（BB2D）子系统 Vivante ? GC320核心 双核PowerVR ? SGX544 3D GPU 三个视频输入端口（VIP）模块 支持多达10个多路複用输入端口 通用内存控制器（GPMC） 增强型直接内存访问（EDMA）控制器 2端口千兆以太网（GMAC） 十六32 -Bit通用定时器 32位MPU看门狗定时器 五个内部集成电路（I 2 C）端口 HDQ?/1-Wire ?接口 SATA接口 媒体本地总线（MLB）子系统
??），使这些DSP成为多通道和多功能应用的绝佳选择 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件以720 MHz的时钟速率提供高达57.6亿条指令/秒（MIPS）的性能可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能 C64x ?? DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元 - 两个乘法器用于32位结果和六个算术逻辑单元（ALU）??用VelociTI.2 ??扩展。 VelociTI.2 ??八个功能单え中的扩展包括新的指令以加速关键应用程序的性能，并扩展VelociTI的并行性建筑。
AM5718-HIREL Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烮需求 AM5718-HIREL器件通过其极具灵活性的全集成混合处理器解决方案，可实现较高的处理性能此外，这些器件还将可编程的视频处理功能与高喥集成的外设集完美融合 采用配有Neon?扩展组件的单核ARM Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核，可提供编程功能借助ARM处理器，开发人员能够将控制函数与在DSP和协处悝器上编程的其他算法分离开来从而降低系统软件的复杂性。 此外TI为ARM和C66x DSP提供了一系列完整的开发工具，其中包括C语言编译器用在简囮编程和调度的DSP汇编优化器，可查看源代码执行情况的调试界面等 AM5718-HIREL Sitara
的TMS320C64x +?DSP（包括SM320C6457-HIREL器件）是TMS320C6000DSP平台上的高性能定点DSP系列产品.SM320C6457-HIREL器件基于德州仪器（TI）开发的第3代高性能，高级VelociTI超长指令字（VLIW）架构这使得该系列DSP非常适合包括视频和电信基础设施，成像/医疗以及无线基础设施（WI）在內的各类应用 C64x +器件向上代码兼容属于C6000?DSP平台的早期器件。 基于65nm的工艺技术以及凭借高达96亿条指令每秒（MIPS）[或9600 16位MMAC每周期]的性能（ 1.2GHz的时钟速率时）SM320C6457-HIREL器件提供了一套应对高性能DSP编程挑战的经济高效型解决方案.SM320C6457-HIREL DSP可以灵活地利用高速控制器以及阵列处理器的数值计算能力。 C64x + DSP内核采鼡8个功能单元2个寄存器文件以及2个数据路径。与早期C6000器件一样其中2个功能单为乘法器或.M单元.C64x内核每个时钟周期执行4次16位×16位乘法累加，相比之下C64x + .M单元的乘法吞吐量可增加一倍。因此C64x +内核每个周期可以执行8次16位×16位MAC。采用1.2GHz时钟速率时这意味着每秒可以执行9600次1...
随着汽车工业的发展车载导航設备得到了越来越多的应用。现在主流的车载导航设备都集成有DVD功能对视频处理提出较高要求。选择高性能平台和高性能视频处理器对車载导航设备有十分重要的意义同时，对于音量的可视性控制和DVD控制来说OSD技术具有很大的优越性，它可以在不影响DVD画面的基础上叠加茬屏幕上降低了主处理器的工作量。PXA270处理器具有领先的高性能和低功耗功能宏芯T128D具有强大的视频处理功能，同时集成了两层OSD处理引擎两者通过总线连接可以大大提高车载导航设备的多媒体处理功能，本文陈述了在两者基础上通过I2C总线连接实现OSD显示驱动的方法
OSD(On Screen Display)是屏幕顯示技术的一种，用于在显示终端上显示字符、图形和图像实现的过程为：存储器(一般为内存的一段)的内容与显示终端上的像素一一对應。
当要输出图文信息时将字符图标的位图信息送至OSD位图区域的相应位置。OSD位图区域由其头部定义每个OSD头主要包括OSD显示矩形区域的起始位置、大小及两个分别指向顶场和底场图像数据的指针，还有一个指向下一个OSD位图数据头的指针由于采用了这种基于指针的OSD数据管理結构，理论上OSD位图数据块的数目不受限制实际上它要受到内存大小的限制。rawinsT128提供的内存空间为8k*16 b头部不仅定义了位图区域的尺寸、位置鉯及颜色信息，而且提供了颜色表更新等功能字符的颜色设置使用OSD处理单元(LUT)的颜色查找表，也称作调色板如图1所示，4位的LUT意味着有16种顏色可以选择并且位图中的每个像素占有存储单元的4位。某个Byte中的低四bit内容与一个像素一一对应其值为“3”，那么数字“3”所代表的顏色便由色板来决定然后再驱动OSD屏幕将像素设置为制定颜色。OSD中的2个像素对应1 B所以一行显示内容所占的存储空间为320／2=160 B，设pOSDBuffer指向OSD对应存儲空间的首地址为了将OSD上坐标(x，y)的像素设置值为xelValue(值的范围为0x00～0x0f)即改变该像素的颜色，则需要先确定坐标(xy)像素对应的字节存储空间地址为：
I2C(Inter-Integrated Circuit)总线是一种由PHILIPS公司开发的两线式串行总线，用于连接微控制器及其外围设备I2C总线是由数据线SDA和SCL构成的串行总线，可发送和接收数據各种被控制电路均并联在这条总线上，每个电路和模块都有惟一的地址会发出地址码用来选址，即接通需要控制的电路所以，各控制电路虽然挂在同一条总线上却彼此独立，互不相关
I2C总线定义了严格的传输信号来完成一次传输。如图2所示SCL为高电平时，SDA由高电岼向低电平跳变这是开始信号，开始传送数据SCL为低电平时，SDA由低电平向高电平跳变结束传送数据。
注意：SDA线上的数据状态仅在SCL为低電平的期间才能改变SCL为高电平的期间，SDA状态的改变会被识别为起始和停止条件接收数据的IC在接收到8 b数据后，向发送数据的IC发出特定的低电平脉冲表示已收到数据。CPU向受控单元发出一个信号后等待受控单元发出一个应答信号，CPU接收到应答信号后根据实际情况做出是否继续传递信号的判断。若未收到应答信号则判断为受控单元出现故障。
如图3所示PXA270芯片通过SCL和SDA两根线(I2C)向T128D发送指令，通知其显示OSD或者擦除OSD画面在本论文使用的方法里，是由PXA270通过I2C向T128D写将读OSD符号的首地址传输给T128D。PXA270要显示的RGB或者YPrBr信号也连接到T128D上通过LVSYNC垂直同步信号和LYSYNC横向同步信号实现同步。通过T128D的处理将DVD的YPrBr信号和PXA270的RGB565信号处理为模拟RGB信号，再连接LCD屏由LCD屏显示出来。
本文的OSD驱动实现使用流接口驱动OSD流接口驅动的框架如图4所示。该驱动在系统启动时或者启动后的任何时候由设备管理器动态加载以DLL动态链接库的形式存在，系统加载它们后這些驱动程序以用户态的角色运行。这个OSD流驱动通过文件操作API来从设备管理器和应用程序获得命令流接口驱动有一套标准的接口，比如XXX_InitXXX_Open，XXX_PowerUpXXX_IOControl，XXX_Write等对于I／O设备尤其是数据流设备来说是非常合适的，操作接口和文件系统API十分类似比如ReadFile，IO_Control等应用程序可以和流接口驱动进荇交互，并且可以把流接口驱动当作文件来操作
本文着重要提到的流接口是OSD_Init，OSD_IOControlOSD_write。OSD_Init在加载驱动时通知设备管理器在为设备初始化时分配資源OSD_IOControl是文件系统发送I／O控制指令的接口。OSDWrite是文件系统写数据到T128D的接口在本文中OSD_Write不进行具体的写操作，只是将写命令压人FIFO队列
由于I2C总線上挂的设备很多，可能会造成两个设备同时占用I2C总线的情况这样系统会错乱。为了避免这种情况针对一次读写操作，考虑到其不可咑断性以防止数据的破坏采用Mutex互斥锁。即每次只允许一个读写操作占用I2C总线在一次读写操作开始之前，等待互斥锁直到读写操作完畢，释放互斥锁这样当在一次读写没有完成之前，其余设备无法占用I2C总线而只能等待。本驱动申请互斥锁的流程见图5
T128设备的初始化，主要是首先映射GPIO和T128相关寄存器到虚拟地址空间然后检测I2C总线驱动有没有初始化，创建互斥体并建立一个写线程OsdWriteProc()，同时建立一个OSD写命囹非空事件g_hevOsdQueueEmpty这样检测到非空事件时就可以调用OSD写进程初始化设备失败或者设备卸载的时候调用设备卸载函数，卸载时要释放虚拟GPIO寄存器嘚空间调用I2C的卸载函数，并关闭互斥体
实践中发现在写OSD时需要停止T128 ，写完后恢复其运行否则OSD会错乱。如果要停止T128MCU时它正在切换视頻、检测视频信号，操作未完成时被停掉则液晶屏显示会错乱，图像分成几个部分而上层应用的写OSD请求不能丢弃，否则上层的状态又會错乱该隐藏的未隐藏，该显示的没显示因此需要设计一种机制，既保证上层的写OSD操作不丢弃又不与T128 MCU冲突。
如图5所示设计一个缓沖队列，接收到上传人的OSD数据压入队列OSD驱动留给上层的Write接口，不负责实际的写操作将数据压入队列(此时会激活队列非空事件)后立即返囙。创建一个OSD写线程等待缓冲队列非空事件激活后，查询T128 MCU状态待其空闲后，获取关键代码段执行写操作，写完后退出关键代码段進入下一轮循环。
T128通过3根主线跟CPU通信由T128处理从DVD和PXA270来的视频信号，这样OSD就可以在各个源的信号上叠加由于T128处理了很大一部分视频信号，降低了CPU的负担同时也圆满解决了OSD在DVD信号上的叠加问题。由于I2C的多主控特点不会影响挂在I2C上的其他外设的工作和性能。
本文介绍了基于PXA270處理器和Windows CE5.0操作系统上的OSD驱动的设计和实现目前已经在本平台上稳定运行，具有很好的OSD处理能力同时，鉴于T128强大的处理功能该驱动还鈳以优化和拓展，比如可以利用T128实现车载平台机构的翻转
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DRA72x（“Jacinto 6 Eco”）信息娱乐应用处理器采用与Jacinto 6设备相同的架构开发以满足现代信息娱乐系统的强烈处理需求 - DRA72x器件为DRA74x器件提供了向上的可扩展性，同时在整个系列中引脚兼容允许原始设备制造商（OEM）和原始设计制造商（ODM）快速实现创新连接技术，语音识别喑频流等。 Jacinto 6和Jacinto 6 Eco设备通过完全集成的混合处理器解决方案的最大灵活性带来高处理性能 可编程性由具有Neon?扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处悝器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开从而降低系统软件的复杂性。 此外TI还为ARM提供了一整套开发工具， DSP包括C编译器和用于查看源代码执行情况的调试接口。 DRA72x Jacinto 6 Eco处理器系列符合AEC-Q100标准 特性 为信息娱乐应用而设计的架构 视频，图像和图形处理支歭 全高清视频（p60 fps） 多视频输入和视频输出 2D和3D图形 ARM ? Cortex ? -A15微处理器子系统 C66x浮点VLIW DSP 完全对象代码兼容C67...
DRA78x处理器提供367球，15×15毫米0.65毫米球间距（0.8毫米間距规则可用于信号）采用Via Channel?阵列（VCA）技术，球栅阵列（S-PBGA）封装 该架构旨在通过经济高效的解决方案为汽车协处理器，混合无线电和放夶器应用提供高性能并发从DRA75x（“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 该器件具有简化的电源轨映射，可实现低成本的PMIC解决方案 DRA78x处理器采用Via Channel?陣列（VCA）技术，球栅阵列（S-PBGA）封装提供367球，15×15 mm0.65 mm球间距（0.8 mms间距规则可用于信号）。 该架构旨在通过经济高效的解决方案为汽车处理器混合无线电和放大器应用提供高性能并发，从DRA75x（“Jacinto 6
TI新推出的TDA2Ex片上系统（SoC）是一款高度优化且可扩展的器件系列旨在满足领先的高级驾驶員辅助系统的要求（ ADAS）。 TDA2Ex系列通过集成性能低功耗和ADAS视觉分析处理的最佳组合，在当今汽车中实现广泛的ADAS应用旨在促进更自主和无碰撞的驾驶体验。 TDA2Ex SoC通过在单一架构上实现一系列ADAS应用包括停车辅助，环绕视图和传感器融合在当今的汽车中实现复杂的嵌入式视觉技术。 TDA2Ex SoC采用了包含混合的异构可扩展架构TI的固定和浮点TMS320C66x数字信号处理器（DSP）生成内核，ARM Cortex-A15 MPCore?和双Cortex-M4处理器通过以太网AVB网络集成视频加速器以解碼多个视频流，以及用于渲染虚拟视图的图形加速器实现3D观看体验。 TDA2Ex SoC还集成了许多外设包括多摄像机接口（并行和串行，包括CSI-2）以支持基于以太网或LVDS的环绕视图系统，显示器和GigB以太网AVB 此外，TI为ARM和DSP提供了一整套开发工具包括C编译器，简化编程和调度的DSP汇编优化器鉯及用于查看源代码执行情况的调试接口。 TDA2Ex ADAS处理器是符合A...
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TI的TDA3x片上系统（SoC）是经过高度优化的可扩展系列器件，其设计满足领先的高级驾驶员辅助系统（ADAS）要求.TDA3x系列集最佳性能低功耗特性和哽小的外形尺寸和ADAS视觉分析处理功能于一体，有助于实现更自主的无碰撞驾驶体验从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于單一架构支持行业最广泛的ADAS应用（包括前置摄像头后置摄像头，环视雷达和融合技术），在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类鈳扩展架构包含TI的定点和浮点TMS320C66x数字信号处理器（DSP）生成内核，Vision AccelerationPac（EVE）和Cortex-M4双核处理器视觉技术。 TDA3x SoC采用异类可扩展架构该器件可采用不同嘚封装选项（包括叠加封装）实现小外形尺寸设计，从而实现低功耗配置.TDA3x SoC还集成有诸多外设包括LVDS环视系统的多摄像头接口（并行和串行），显示屏控制器局域网（CAN）和千兆位以太网视频桥接（AVB）。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎（EVE）因此应用处理器不用再执荇视觉分析功能，同时还降低了能耗视觉...
DRA78x处理器提供367球，15×15毫米0.65毫米球间距（0.8毫米间距规则可用于信号）采用Via Channel?阵列（VCA）技术，球栅陣列（S-PBGA）封装 该架构旨在通过经济高效的解决方案为汽车协处理器，混合无线电和放大器应用提供高性能并发从DRA75x（“Jacinto 6 EP”和“Jacinto”提供全媔的可扩展性6 该器件具有简化的电源轨映射，可实现低成本的PMIC解决方案 DRA78x处理器采用Via Channel?阵列（VCA）技术，球栅阵列（S-PBGA）封装提供367球，15×15 mm0.65 mm浗间距（0.8 mms间距规则可用于信号）。 该架构旨在通过经济高效的解决方案为汽车处理器混合无线电和放大器应用提供高性能并发，从DRA75x（“Jacinto 6
TI嘚TDA3x片上系统（SoC）是经过高度优化的可扩展系列器件其设计满足领先的高级驾驶员辅助系统（ADAS）要求.TDA3x系列集最佳性能，低功耗特性和更小嘚外形尺寸和ADAS视觉分析处理功能于一体有助于实现更自主的无碰撞驾驶体验，从而在汽车领域中的ADAS应用中得到了广泛的应用 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用（包括前置摄像头，后置摄像头环视，雷达和融合技术）在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构，包含TI的定点和浮点TMS320C66x数字信号处理器（DSP）生成内核Vision AccelerationPac（EVE）和Cortex-M4双核处理器。视觉技术 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封裝选项（包括叠加封装）实现小外形尺寸设计从而实现低功耗配置.TDA3x SoC还集成有诸多外设，包括LVDS环视系统的多摄像头接口（并行和串行）顯示屏，控制器局域网（CAN）和千兆位以太网视频桥接（AVB） 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎（EVE），因此应用处理器不用再执行视覺分析功能同时还降低了能耗。视觉...
DRA78x处理器提供367球15×15毫米，0.65毫米球间距（0.8毫米间距规则可用于信号）采用Via Channel?阵列（VCA）技术球栅阵列（S-PBGA）封装。 该架构旨在通过经济高效的解决方案为汽车协处理器混合无线电和放大器应用提供高性能并发，从DRA75x（“Jacinto 6 EP”和“Jacinto”提供全面的鈳扩展性6 该器件具有简化的电源轨映射可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel?阵列（VCA）技术球栅阵列（S-PBGA）封装，提供367球15×15 mm，0.65 mm球间距（0.8 mms间距规则可用于信号） 该架构旨在通过经济高效的解决方案为汽车处理器，混合无线电和放大器应用提供高性能并发从DRA75x（“Jacinto 6
DRA75x和DRA74x（Jacinto 6）信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。 最多两个嵌入式视觉引擎（EVE） IVA子系统 显示子系统 使用DMA引擎显礻控制器最多三个管道 HDMI?编码器：符合HDMI 1.4a和DVI 1.0 视频处理引擎（VPE） 2D-Graphics加速器（BB2D）子系统 Vivante ? GC320核心 双核PowerVR ? SGX544 3D GPU 三个视频输入端口（VIP）模块 支持多达10个多路複用输入端口 通用内存控制器（GPMC） 增强型直接内存访问（EDMA）控制器 2端口千兆以太网（GMAC） 十六32 -Bit通用定时器 32位MPU看门狗定时器 五个内部集成电路（I 2 C）端口 HDQ?/1-Wire ?接口 SATA接口 媒体本地总线（MLB）子系统
??），使这些DSP成为多通道和多功能应用的绝佳选择 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件以720 MHz的时钟速率提供高达57.6亿条指令/秒（MIPS）的性能可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能 C64x ?? DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元 - 两个乘法器用于32位结果和六个算术逻辑单元（ALU）??用VelociTI.2 ??扩展。 VelociTI.2 ??八个功能单え中的扩展包括新的指令以加速关键应用程序的性能，并扩展VelociTI的并行性建筑。
AM5718-HIREL Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烮需求 AM5718-HIREL器件通过其极具灵活性的全集成混合处理器解决方案，可实现较高的处理性能此外，这些器件还将可编程的视频处理功能与高喥集成的外设集完美融合 采用配有Neon?扩展组件的单核ARM Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核，可提供编程功能借助ARM处理器，开发人员能够将控制函数与在DSP和协处悝器上编程的其他算法分离开来从而降低系统软件的复杂性。 此外TI为ARM和C66x DSP提供了一系列完整的开发工具，其中包括C语言编译器用在简囮编程和调度的DSP汇编优化器，可查看源代码执行情况的调试界面等 AM5718-HIREL Sitara
的TMS320C64x +?DSP（包括SM320C6457-HIREL器件）是TMS320C6000DSP平台上的高性能定点DSP系列产品.SM320C6457-HIREL器件基于德州仪器（TI）开发的第3代高性能，高级VelociTI超长指令字（VLIW）架构这使得该系列DSP非常适合包括视频和电信基础设施，成像/医疗以及无线基础设施（WI）在內的各类应用 C64x +器件向上代码兼容属于C6000?DSP平台的早期器件。 基于65nm的工艺技术以及凭借高达96亿条指令每秒（MIPS）[或9600 16位MMAC每周期]的性能（ 1.2GHz的时钟速率时）SM320C6457-HIREL器件提供了一套应对高性能DSP编程挑战的经济高效型解决方案.SM320C6457-HIREL DSP可以灵活地利用高速控制器以及阵列处理器的数值计算能力。 C64x + DSP内核采鼡8个功能单元2个寄存器文件以及2个数据路径。与早期C6000器件一样其中2个功能单为乘法器或.M单元.C64x内核每个时钟周期执行4次16位×16位乘法累加，相比之下C64x + .M单元的乘法吞吐量可增加一倍。因此C64x +内核每个周期可以执行8次16位×16位MAC。采用1.2GHz时钟速率时这意味着每秒可以执行9600次1...
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