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UVM中如何根据DUT的状态来发送不同的sequence
在UVM验证中，如何根据DUT的某些信号状态来发送不同的sequence，从而发送不同的data items。在《A Practical Guide to Adopting the Universal Verification Methodology(UVM)》中5.3.1节提到reactive generation - the contents of the data items can be influenced by the state of the DUT.但是没有提到怎么实现。你的位置：
请问UVM中sequence 和 sequencer有什么区别？
正在学习UVM，被sequence和sequencer这两个概念搞晕了
& & 希望大牛能讲解或总结一下，谢谢：）目前我判断应该是sequence和sequencer没有关联上，因为driver没有收到transaction，但是下面这句
uvm_config_db#(uvm_object_wrapper)::set(this,&t_env.ahb_mseqr.main_phase&,
& && && && && && && && && &&default_sequence&, ahb_master_sequence::type_id::get());
应该就是关联sequencer和sequence吧？说实话这个是从uvm自带的那个ubus的例子抄来的，我也没看明白，例子里面sequencer是直接用的uvm_sequence定义的instance，也就是说sequencer的成员里面显然不包含sequence，仿真结果打印的topology也印证了这一点，那么例子里是怎么关联上的呢？而且从这个build_phase看，先设置了seqr.seq.num_trans的值，然后才关联seqr和seq？
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t_env是不是应该在build_phase里用create出来啊？
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本帖最后由 fighter212 于
21:43 编辑
stephen_0921
谢谢这位朋友，我按你说的做了，把new里面去掉，改在build_phase里面用create创建，但是还是不行，log可以看到UVM_INFO ../tb/ahb_master_sequence.sv(15) @ 0: uvm_test_top.t_env.ahb_mseqr@@ahb_master_sequence [No transaction fed:] uvm_te st_top.t_env.ahb_mseqr.ahb_master_sequence use default num_trans
UVM_INFO @ 0: uvm_test_top.t_env.ahb_mseqr@@ahb_master_sequence [uvm_test_top.t_env.ahb_mseqr.ahb_master_sequence] Start tran sfering...
这个是不是说ahb_mseqr已经有ahb_master_sequence这个成员了啊，但是ahb_master_sequence是类，不是实例，怎么回事呢？ubus的demo仿真log也是一样的结果，但是就可以正常产生数据并发送到driver，有人仔细研究过这个demo吗？
我改在env类里面定义一个sequence成员ahb_mseq，然后在env的run_phase中用这个ahb_mseq.start(ahb_mseqr, null)
，driver就可以从sequencer收到数据了，但参数num_trans还是无法传递。
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目前我判断应该是sequence和sequencer没有关联上，因为driver没有收到transaction，但是下面这句
uvm_con ...
fighter212 发表于
& & 这个set 就指定sqr里面default sequence 为ahb_master_sequence&&不代表这个sqr里面有ahb_master_sequence ，只是让sqr执行default sequence时候 执行的ahb_master_sequence&&.而你set num_trans 到sqr里面的ahb_master_sequence,实际上sqr里面没有ahb_master_sequence这个member ，所以get不到
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<td class="t_msgfont" id="postmessage_. 在sequencer里面定义一个num_trans
2. 在env::build_phase里面改为uvm_config_db#(int)::set(this, &t_env.ahb_mseqr&,&num_trans&,2);
3. 在sequence里面将
if(!(uvm_config_db#(int)::get(null,get_full_name(),&num_trans&, num_trans)));
& && && &`uvm_info(&No transaction fed:&,{get_full_name(), & use default num_trans&}, UVM_LOW);
变成num_trans=m_sequencer.num_
--good luck
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感谢各位朋友热情帮忙，昨晚在试的时候把那个main_phase改成run_phase就可以了，循环的次数随着我设置的值在增加，但是sequence里面仍然打印出了&no transaction fed...&的信息。暂时还不知道为什么。另外demo里面用main_phase却又可以
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犯了个低级错误，打印出了&no transaction fed...&的信息是因为if语句后面多了个分号：（
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哈哈，我说呢，如果你打开transaction的打印，估计就知道有没有set/get成功了吧
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