关于arm中arm堆栈回溯中暂存局部变量是如何存取的问题

很多时候我们都会对M0M0+,M3,M4,M7arm7,arm9CORTEX-A系列,或者说AVR,51PIC等,一头雾水只知道是架构,不知道具体是什么有哪些不同?今天查了些资料来解解惑,不是很详细但对此有个夶体了解。咱先来当下最火的ARM吧

ARM即以英国ARM(Advanced RISC Machines)公司的内核芯片作为CPU同时附加其他外围功能的嵌入式开发板,用以评估内核芯片的功能和研发各科技类企业的产品.
ARM 微处理器目前包括下面几个系列以及其它厂商基于 ARM 体系结构的处理器,除了具有ARM 体系结构的共同特点以外每┅个系列的 ARM 微处理器都有各自的特点和应用领域。 
  32位RISCCPU开发领域中不断取得突破其设计的微处理器结构已经从v3发展到现在的v7。Cortex系列处理器昰基于ARMv7架构的
分为Cortex-M、Cortex-R和Cortex-A三类。由于应用领域的不同基于v7架构的Cortex处理器系列所采用的技术也不相同。基于v7A的称为“Cortex-A系列
高性能的Cortex-A15、可伸缩的Cortex-A9、经过市场验证的Cortex-A8处理器以及高效的Cortex-A7和Cortex-A5处理器均共享同一体系结构,因此具有完整的应用兼容性支持传统的ARM、Thumb指令集
和新增的高性能紧凑型Thumb-2指令集。

由于ARM公司只对外提供ARM内核各大厂商在授权付费使用ARM内核的基础上研发生产各自的芯片,形成了嵌入式ARM CPU的大家庭提供这些内核芯片的厂商有Atmel、TI、飞思卡尔、NXP、ST、和三星等。

  为了能做到Cortex-M软件重用ARM公司在设计Cortex-M处理器时为其赋予了處理器向下兼容软件二进制向上兼容特性。

  首先看什么是二进制兼容这个特性主要是针对软件而言,这里指的是当某软件(程序)依賴的头文件或库文件分别升级时软件功能不受影响。要做到二进制兼容被软件所依赖的头文件或库文件升级时必须是二进制兼容的。

  那么什么又是向上兼容向上兼容又叫向前兼容,指的是在较低版本处理器上编译的软件可以在较高版本处理器上执行

  跟向上兼容相对的另一个概念叫向下兼容,向下兼容又叫向后兼容指的是较高版本处理器可以正确运行在较低版本处理器上编译的软件。

  所以其实既可以用向上兼容也可以用向下兼容来形容Cortex-M特性,只不过描述的主语不一样我们可以说Cortex-M程序是向上兼容的,也可以说Cortex-M处理器昰向下兼容的

  具体到Cortex-M处理器时,这个兼容特性表现为:

  • 从处理器角度看:CM0指令集和功能模块是最精简的CM7指令集和功能模块是最丰富的。不存在低版本处理器上存在的特性是高版本处理器所没有的
  • 从软件角度来看:CMSIS提供的头文件和功能函数是二进制向上兼容的,比洳某CM0软件App使用的是core_、MSIL、Python 和 Perl)速度

ARM公司的Cortex-A系列处理器适用于具有高计算要求、运行丰富操作系统以及提供交互媒体和图形体验的应用领域。从最新技术的移动Internet必备设备(如手机和超便携的上网本或智能本)到汽车信息娱乐系统和下一代数字电视系统也可以用于其他移动便攜式设备,还可以用于数字电视、机顶盒、企业网络、打印机和服务器解决方案这一系列的处理器具有高效低耗等特点,比较适合配置於各种移动平台

虽然Cortex-A处理器正朝着提供完全的Internet体验的方向发展,但其应用也很广泛包括:

上网本、智能本、输入板、电子书阅读器、瘦客户端

、无线基站、VOIP 电话和设备

Web 2.0、无线基站、交换机、服务器

ARM Cortex?-A5 处理器是能效最高、成本最低的处理器,能够向最广泛的设备提供 Internet 访问:从入门级智能手机、低成本手机和智能移动终端到普遍采用的嵌入式、消费类和工业设备

这些处理器向特别注重功耗和成本的应用程序提供高端功能,其中包括:

多重处理功能可以获得可伸缩、高能效性能

高性能内存系统,包括高速缓存和内存管理单元

ARM Cortex?-A7 MPCore? 处理器是 ARM 迄今为止开发的最有效的应用处理器它显著扩展了 ARM 在未来入门级智能手机、平板电脑以及其他高级移动设备方面的低功耗领先地位。

Cortex-A7 处悝器的体系结构和功能集与 Cortex-A15 处理器完全相同不同这处在于,Cortex-A7 处理器的微体系结构侧重于提供最佳能效因此这两种处理器可在 

配置中协哃工作,软件可以在高能效 Cortex-A7 处理器上运行 也可以在需要时在高性能 Cortex-A15 处理器上运行 无需重新编译,[2]

  从而提供高性能与超低功耗的终极组合

作為独立处理器,单个 Cortex-A7 处理器的能源效率是 ARM Cortex-A8 处理器(支持如今的许多最流行智能手机)的 5 倍性能提升 50%,而尺寸仅为后者的五分之一

Cortex-A7 可以使 年期间低于 100 美元价格点的入门级智能手机与 2010 年 500 美元的高端智能手机相媲美。这些入门级智能手机在发展中世界将重新定义连接和 Internet 使用

朂佳的功效和占用空间,可作为独立的应用处理器 性能高于 2011 年主流智能手机 CPU 性能提升高达 20% 而功耗降低 60%AMBA 4 ACE 一致性接口支持大小 CPU 群集之间 20us 以下的仩下文迁移

ARMCortex-A8处理器是一款适用于复杂操作系统及用户应用的应用处理器其结构如图所示。支持智能能源管理(IEMIntelligentEnergyManger)技术的ARMArtisan库以及先进的泄漏控制技术,使得Cortex-A8处理器实现了非凡的速度和功耗效率在65nm上艺下ARMcortex-A8处理器的功耗不到300mW,能够提供高性能和低功耗它第一次为低费用、高容量嘚产品带来了台式机级别的性能

Cortex-A8处理器是第一款基于下一代ARMv7架构的应用处理器使用了能够带来更高性能、更低功耗和更高代码密度的Thumb-2技術它首次采用了强大的NEON信号处理扩展集,为H.264和MP3等媒体编解码提供加速

Cortex-A8的解决方案还包括Jazelle-RCTJava加速技术对实时(JIT)和动态调整编译(DAC)提供最优化,同時减少内存占用空间高达3倍该处理器配置了先进的超标量体系结构流水线能够同时执行多条指令,并且提供超过2.0DMIPS/MHz的性能处理器集成了一個可调尺寸的二级高速缓冲存储器能够同高速的16KB或者32KB一级高速缓冲存储器一起工作,从而达到最快的读取速度和最大的吞吐量新处理器還配置了用于安全交易和数字版权管理的TrustZone技术以及实现低功耗管理的IEM功能

Cortex-A8处理器使用了先进的分支预测技术,并且具有专用的NEON整型和浮點型流水线进行媒体和信号处理在使用小于4mm2的硅片及低功耗的65nm工艺的情况下Cortex-A8处理器的运行频率将高于600MHz(不包括NEON追踪技术和二级高速缓冲存儲器)在高性能的90nm和65nm工艺下,Cortex-A8处理器运行频率最高可达1GHz能够满足高性能消费产品设计的需要。

ARM Cortex?-A9 处理器提供了史无前例的高性能和高能效从而使其成为需要在低功耗或散热受限的成本敏感型设备中提供高性能的设计的理想解决方案。 它既可用作单核处理器也可用作可配置的多核处理器,同时可提供可合成或硬宏实现该处理器适用于各种应用领域,从而能够对多个市场进行稳定的软件投资

与高性能计算平台消耗的功率相比,ARM Cortex-A9 处理器可提供功率更低的卓越功能其中包括:

无与伦比的性能,2GHz 标准操作可提供 TSMC 40G 硬宏实现

以低功耗为目标的单核实现面向成本敏感型设备

利用高级 MPCore 技术,最多可扩展为 4 个一致的内核

ARM Cortex?-A15 MPCore? 处理器是性能高且可授予许可的处理器它提供前所未有的處理功能,与低功耗特性相结合在各种市场上成就了卓越的产品,包括智能手机、平板电脑、移动计算、高端数字家电、服务器和无线基础结构Cortex-A15 MPCore 处理器提供了性能、功能和能效的独特组合,进一步加强了 ARM 在这些高价值和高容量应用细分市场中的领导地位

Cortex-A15 MPCore 处理器具有无序超标量管道,带有紧密耦合的低延迟 2 级高速缓存该高速缓存的大小最高可达 4MB。

和 NEON? 媒体性能方面的其他改进使设备能够为消费者提供丅一代用户体验并为 Web 基础结构应用提供高性能计算。

预计 Cortex-A15 MPCore 处理器的移动配置所能提供的性能是当前的高级智能手机性能的五倍还多在高级基础结构应用中,Cortex-A15 的运行速度最高可达 2.5GHz这将支持在不断降低功耗、散热和成本预算方面实现高度可伸缩的解决方案。

cortex-a57是ARM针对2013年、2014年囷2015年设计起点的CPU产品系列的旗舰级CPU它采用armv8-a架构,提供64位功能而且通过Aarch32执行状态,保持与ARMv7架构的完全后向兼容性在高于4GB的内存广泛使鼡之前,64位并不是移动系统真正必需的即便到那时也可以使用扩展物理寻址技术来解决,但尽早推出64位可以实现更长、更顺畅的软件遷移,让高性能应用程序能够充分利用更大虚拟地址范围来运行内容创建应用程序例如视频编辑、照片编辑和增强现实。新架构可以运荇64位操作系统并在操作系统上无缝混合运行32位和64位应用程序。ARMv8架构可以实现状态之间的轻松转换

除了ARMv8的架构优势之外,Cortex-A57还提高了单个時钟周期性能比高性能的Cortex-A15CPU高出了20%至40%。它还改进了二级高速缓存的的设计以及内存系统的其他组件极大的提高了能效。Cortex-A57将为移动系统提供前所未有的高能效性能水平而借助big.LITTLE,SoC能以很低的平均功耗做到这一点

Cortex-A72是ARM性能最出色、最先进的处理器。于2015年年初正式发布的Cortex-A72是基于ARMv8-A架构、并构建于Cortex-A57处理器在移动和企业设备领域成功的基础之上在相同的移动设备电池寿命限制下,Cortex-A72能相较基于Cortex-A15的设备提供3.5倍的性能表现展现优异的整体功耗效率。

Cortex-A72的强化性能和功耗水平重新定义了2016年高端设备为消费者带来的丰富连接和情境感知(context-aware)的体验这些高端设備涵盖高阶的智能手机、中型平板电脑、大型平板电脑、翻盖式笔记本、一直到外形规格可变化的移动设备。未来的企业基站和服务器芯爿也能受惠于Cortex-A72的性能并在其优异的能效基础上,在有限的功耗范围内增加内核数量提升工作负载量。

Cortex-A72是目前基于ARMv8-A架构处理器中性能最高的处理器它再次展现了ARM在处理器技术的领先地位,在提升新的性能标准之余同时大幅降低功耗,可广泛地扩展应用于移动与企业设備

智能手机是目前大众主要的计算平台,提供使用者随时随地创造、强化以及使用内容的功能拟真且复杂的图像与视频捕捉、主机级遊戏般的性能、用来进行文档与办公应用流畅处理的生产力套件等,这些需求促使Cortex-A72如此高端性能的处理器面市执行这些服务的设备被要求在更轻薄、更时尚的外形设计之下,必须全天候处理日益增长的CPU和GPU工作负载这使得制造商不得不将精力用在寻找高能效的处理器内核。在智能手机、平板电脑、甚至是大尺寸的移动设备Cortex-A72能通过出色的能效与内存系统,提功绝佳的用户体验将Cortex-A72与Cortex-A53处理器以ARMbig.LITTLE?(大小核)處理器进行配置,可以扩展整体的性能与效率表现

}

映像文件加载时域包括RO和RW段运荇时域则包括RO、RW和ZI三个段。其中RO和RW段的内容在加载时和运行时是一样的只是存储空间可能不同,而ZI段则是运行时由初始化函数创建的

       RO段:Read-Only段,包括源程序中的CODE段只读数据段(包括变量的初始化值——可以是任意变量,全局/局部、静态/动态变量的初值;还包括数据常量——这个常量也可以是全局的或局部的也就是说,编译器既要为变量分配存储空间——变量是可读写的并不放在RO段,又要为变量的初徝分配存储空间两者是两回事)。

       上面简单总结了映像文件各段的组成从程序的组成看,可以分为变量、数据和代码其中变量又分為全局/局部的或静态/动态的,它们的存储空间又是如何分配的呢

       数据:这里所指的数据都是常量(若可变则为变量),也包括指针常量那么也属于只读的数据,也由编译器分配存储空间放到映像文件的RO段

       变量:主要根据生存期来分,因为生存期是按在内存中的生存时間来定义的而作用域与存储空间分配无关。

       1.全局变量和静态变量:包括静态局部变量和全局/静态指针变量在内由编译器分配存储空間,已初始化的放到RW段否则放到ZI段;

)进行移植,主要是正确设置堆(heap)和栈(stack)的地址它可以使用C或ARM汇编语言来编写,并至少返回堆基址(保存在R0中)栈基址(保存在R1)可选。因而一个简单的汇编语言编写的__user_initial_stackheap( )函数如下:

Limit|作为堆(heap)的基址(即把heap和stack区放置在ZI区域的上方这也被认为是标准的实现[7])。但是如果使用scatter文件实现分散加载机制,链接器并不生成符号|ImageZI

Limit|这时就必须自己重新实现__user_initial_stackheap( )函数并且设置好堆基址和栈顶,否则链接时会报错

limit),四是让堆区保持8字节对齐[6]

       (1)在嵌入式应用中,启动代码分为两个部分:一是系统的初始化包括中断向量表的建立、时钟、存储系统初始化、关键I/O口初始化、各处理器模式下的栈指针初始化等;二是应用程序初始化(或说C库函数初始化),包括RW段的搬移和ZI段的清零、C应用程序arm堆栈回溯区的建立(__user_initial_stackheap()函数初始化arm堆栈回溯指针)等

       (2)但两者并不是没有联系的。以单區模型的arm堆栈回溯区为例由于栈是向下生长的,堆是向上生长的系统模式的栈指针(与用户模式相同,共用一个R13寄存器来描述)实际仩定义了用户模式下单区模型arm堆栈回溯区的上限而__user_initial_stackheap()函数中指定的heap基址则成为该arm堆栈回溯区的下限。

       前面已经指出启动代码包括系统初始化以及应用程序运行环境的初始化两个部分,完成初始化后就可以呼叫用户主程序了。参考资料[1]、[3]和[5]等都对两个部分的内容以及过程列出了非常清晰但又简单明了的步骤这对于初学者来说稍微有点抽象。

如果不需要使用MMU进行地址重映射那么,结合网上可以搜集的示唎boot代码以及分析文档加上自己动手移植和调试,也是比较容易理解的如果是使用处理器自带的Remap控制寄存器来进行地址重映射,网上也囿相关的代码例如网友twentyone的boot代码【4510 bootloader的实现与分析(附源代码)】就非常清楚,另外在《ARM学习报告》系列文章中也对其有详细的分析。

对於在启动过程中要使用MMU进行地址重映射的系统初始化顺序在《使用AXD调试MMU地址映射程序手记(二)》一文中给出了一个参考步骤,并做了┅定的说明通过进一步参考权威资料,这里对系统初始化顺序作了小的改进与修正如下:

①禁止所有中断→②初始化时钟→③初始化存储器→④初始化各模式下的栈指针→⑤初始化GPIO→⑥拷贝映像文件到SDRAM→⑦建立地址重映射表→⑧使能MMU→⑨应用程序初始化(RW&ZI区)→⑩使能異常中断→⑾呼叫主程序(dummyOS)。

主要对使能异常中断和应用程序初始化的顺序做了调整即先进行应用程序的初始化,再使能异常中断鈳参考[3]和[10]。

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[1]《ARM体系结构与编程》杜春雷,清华夶学出版社2003年2月

[2]《ARM嵌入式系统开发——软件设计与优化》,沈建华译2005年5月

[3]《基于ARM的嵌入式系统程序开发要点》,费浙平2003年8月

[9]《堆与棧的区别》,未知网友

编辑:什么鱼 引用地址:
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基于ARM的服务器产品当中,有┅些公司正在争夺尽可能多的市场这些公司不仅要吸引x86客户,而且他们还有相互竞争以获得客户他们中的大多数通过拥有高度专注和利基产品来针对一些关键的特定市场。Ampere是其中之一现在该公司的投资者阵容中出现了非常稳固强大的成员ARM。Ampere由前英特尔总裁RenéeJames创立由凱雷集团资助,自2018年10月开始提供eMAG系列处理器该公司于2018年初购买了AppliedMicro的基于X-Gene ARM的服务器资产,并提供定制的基于ARM v8.0架构的32核芯片采用TSMC 台积电16FF +工藝构建,运行频率为3.3 GHz该芯片基于X-Gene II平台并进行了优化

2018年,ARM中国业务完成拆分成立了由中方控股51%的合资公司。作为ARM公司在中国IP业务的总部安谋科技(中国)有限公司将向总部设在中国的合作伙伴开展集成电路知识产权(IP)的授权与技术服务;并结合中国市场需求自主研发基于ARM技术的IP与标准,赋能中国智能科技创新 ARM公司继2018年9月推出汽车安全强化处理器Cortex-A76AE之后,12月又推出了一款新的自动驾驶汽车芯片——Cortex-A65AE它吔是面向汽车电子市场的,主要针对7nm优化其最大特点就是支持了SMT多线程,性能吞吐率比前代高3.5倍预计2020年上市。 2019第四届ADAS与自动驾驶论坛於3月21-22日在上

 Arm提供端到端物联网安全机制以满足水电、天然气和水计量中从设备到数据的应用需求。  Arm 与各大智能电表以及先进仪表基础设施(Advance Meter Infrastructure;AMI)厂商合作联手在Mbed OS 与Pelion 物联网平台的基础上为公共设施提供完备的物联网解决方案。 EDMI 运用Pelion物联网平台进行连接、管理、以及扩展各种智能仪表解决方案 Arm宣布与EDMI合作,将Mbed OS 与Pelion 物联网平台整合到先进的智能仪表解决方案中实现安全的设备连接、管理、固件升级,并为未来物聯网公共设施的应用打下基础 随着智能公共事业的快速

big.LITTLE架构的核心优势,为数字电视市场的芯片发展开创全新局面 当前,电视系统正邁入革命性的新时代更高分辨率的视频、全面扩展的服务以及全新的AI驱动功能,将带动用户需求的提升与设备数量的增长这让终端消費者为之振奋,但同时也为SoC芯片设计人员带来巨大的挑战要在电视系统中增加上述功能,意味着芯片的复杂度也随之增加因此工程团隊不仅要努力在成本与功能之间找到平衡点,还需提供出色的用户体验并缩短产品的上市时间。 Arm的合作伙伴联咏科技致力于提供种类众哆的显示驱动IC以及多媒体SoC

从ARM转到STM开发开发工具也由ADS转到了Keil。借助STM的固件库使得开发效率更加高效,比如你可以不用关心启动代码的具體实现只需要专注于具体的应用代码,嵌入式开发也变得越来越“傻瓜”此事好坏,暂且不论来看看STM启动代码的特点,或者说相对於ARM的区别通常的启动代码结构:1.  首先是中断向量表的定义.?     

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关于debuggerd的原理在这里就不赘述了。

1确保要调试嘚进程中没有重写信号处理函数。

在我们的中间件中libqin_buslib.so中,重写了信号处理函数这样会覆盖系统默认的信号处理函数,导致debuggerd无法捕获信號

如果该目录不存在,那么debuggred无法将arm堆栈回溯写入tombstone文件

我们知道,只要拿到的backtrace中有函数信息我们就可以找到死机对应的大体位置,通過添加多行打印的方法来一点点逼近死机位置。

但是这种方法也有他的局限性:

  • 效率不够高,特别是针对小概率死机问题
  • 添加了多行咑印后有可能影响多线程的运行时序,导致死机更难复现

因此拿到第一次backtrace后就能精准定位死机位置的方法,才是高大上的方法

当前函数#00的PC是0xd3c,外层调用函数#01的pc是1a94(返回地址是1a98)因此,0xd3c和0x1a94处到底指的是哪一行源码是我们要求证的终极目标。

先来分析so库的反汇编信息:

0xd3c处的指令 ldr r2,[r3] 表示的含义是将寄存器r3的值所表示的内存地址处的数据,读入寄存器r2

而0x显然是个不可访问的非法地址,因此触发了signal 11.

但此指囹属于哪一个函数的哪一行呢

我们知道,静态函数只在当前源文件内有效因此链接器不会浪费PLT资源来寻址静态函数,只需要用段内相對寻址就完全可以了<istb_porting_player_init-0x7b4>就是一个典型的段内相对寻址,因此0xd3c处指令很可能属于一个静态函数,只不过由于编译优化处理我们从so文件中昰无法获取静态函数符号的。

因此0xd10应该是函数#00的入口。

我们看0xd10处指令

含义是将fp和lr寄存器压栈,这是典型的函数入口指令从objdump文件中可鉯看出,所有其他函数的入口都是这一条指令

因此,这证实了0xd10是函数#00的入口

由于本人能力有限,从对.so的objdump文件中只能分析到这一步,結论是:

1死机的最内层函数的入口地址是0xd10(相对于so文件的.text段的偏移);

至于#00到底是哪一个函数,0xd3c到底是对应的是函数#00内的哪一行代码從so的objdump文件中无法继续分析了。

我们知道从.o目标文件链接生成.so动态库文件的过程中,动态连接器虽然对所有.o文件进行了section合并、GOT生成、指令哋址修正等大量处理但是,.o中某条指令相对于该函数入口的偏移地址并没有被改变它和.so中是一样的。

因此我们可以对.o文件进行反汇編,编译.o时一定要加-g选项,这样才能生成源码和汇编对应的调试信息;

其中-S表示反汇编时,同时保留对应的源码这正是我们想要的信息。

从上述汇编可以看出0xdb4处代表的是源码是

并且上一条指令是死机时当前函数的pc:

因此,我们得出#00函数便是set_signatureCode这正是一个静态函数。

峩们已经知道死机指令相对于该函数的偏移地址是0x2c,因此死机位于:0x2c + 0x2c = 0x58,

这恰好就是我们从so的反汇编分析中得到的死机指令

死机指令對应的源代码:

很明显,r3寄存器目前存的就是pCur变量的值0x,pCur是一个指针0x这个值对于指针来说显然是非法的。

我咋找不到在哪添加附件

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